#author("2019-07-04T10:08:16+09:00","","")
#author("2019-07-04T10:13:19+09:00","","")
*MIPS (CPU) [#n7c0a2c1]
**What is a MIPS? [#nf7a3652]
MIPSとはMicroprocessor without Interlocked Pipeline Stagesの略称で、RISC (Reduced Instruction Set Architecture) と呼ばれる命令セットアーキテクチャの一つである。1985年にMIPS Computer Systemsによって最初のMIPSであるR2000が発表された。
MIPSとはMicroprocessor without Interlocked Pipeline Stagesの略称で、RISC (Reduced~
Instruction Set Architecture) と呼ばれる命令セットアーキテクチャの一つである。~
1985年にMIPS Computer Systemsによって最初のMIPSであるR2000が発表された。
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**MIPSの特徴 [#u31ca7bb]
MIPSはwithout interlocked pipeline stageとあるように、命令パイプラインにインターロックされたステージが内容にする命令セットアーキテクチャである。従来のRISCでは一つのパイプラインのステージが処理を終えるまで、それより前のステージは固定されて(インターロックされて)新しい命令が入ってこれなかった。それをMIPSでは全ての命令を1クロックサイクルで統一することで、全てのステージが常に処理を行える、つまりインターロックされないように改良した。これによって命令の処理速度が格段に向上した。
MIPSはwithout interlocked pipeline stageとあるように、命令パイプラインにインターロック~
されたステージが内容にする命令セットアーキテクチャである。従来のRISCでは一つの~
パイプラインのステージが処理を終えるまで、それより前のステージは固定されて~
(インターロックされて)新しい命令が入ってこれなかった。それをMIPSでは全ての命令を~
1クロックサイクルで統一することで、全てのステージが常に処理を行える、つまり~
インターロックされないように改良した。これによって命令の処理速度が格段に向上した。
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**MIPSのパイプラインのデザイン [#aecf9682]
MIPSのパイプラインは、下図のような5つのステージに分かれている。
[[https://upload.wikimedia.org/wikipedia/commons/thumb/e/ea/MIPS_Architecture_%28Pipelined%29.svg/1280px-MIPS_Architecture_%28Pipelined%29.svg.png]]
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**MIPSの命令形式 [#aa7f2805]
[[https://image.slidesharecdn.com/kagamicomput201807-180406181801/95/kagamicomput201807-11-638.jpg]]
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**MIPSの命令セットのグリーンシート [#mb704584]
[[https://d20ohkaloyme4g.cloudfront.net/img/document_thumbnails/309c0dbde82179fa7e2ba89bff63e5da/thumb_1200_1480.png]]
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**Reference [#j41123d6]
- https://ja.wikipedia.org/wiki/MIPS%E3%82%A2%E3%83%BC%E3%82%AD%E3%83%86%E3%82%AF%E3%83%81%E3%83%A3#MIPS_CPU_%E3%83%95%E3%82%A1%E3%83%9F%E3%83%AA~
-https://www.slideshare.net/swkagami/kagamicomput201807
-https://www.studocu.com/en/document/california-state-university-long-beach/computer-architecture/lecture-notes/mips-green-sheet-mips-instruction-set-architecture/2202547/view~

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